8
LT3150
3150f
BLOCK DIAGRA S
SW2
NORMALLY
CLOSED
I
2
5礎
+
ERROR AMP
COMP
3150 BD02
+
COMP1
Q9
SHDN2
V
IN2
GND
FB2
R10
5k
SW1
NORMALLY
OPEN
100mV
HYSTERESIS
I
1
15礎
I
3
100礎
+
I
LIM2
AMP
V
TH1
50mV
V
TH2
1V
D1
I
POS
I
NEG
GATE
D2
+
COMP2
COMP3
OR2
START-UP
V
REF
1.21V
R9
50k
OR1
Q7
Q6
Q5
Q4
Q8
4
5
6
8
R8
(EXTERNAL)
R7
(EXTERNAL)
V
OUT
FB2
9
11
12
13
+
FF
R
Q
S
0.15&
SW
DRIVER
COMPARATOR
2
SHUTDOWN
SHDN1
14
1
+
?/DIV>
RAMP
GENERATOR
R
C
100k
C
C
40pF
1.4MHz
OSCILLATOR
SWGND
3150 BD1
R6
40k
R4
140k
R3
30k
Q2
x10
Q1
Q3
R2
(EXTERNAL)
R1
(EXTERNAL)
R5
40k
V
IN2
V
IN1
V
IN1
3
FB1
FB1
16
GND
15
A2
A1
I
LIM1
g
m
= 77祄hos
Boost Switching Regulator
Linear Regulator Controller
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